半导体晶圆制造中金属间介质填充方法

摘要

本发明公开了一种半导体晶圆制造中金属间介质填充方法，通过在O3TEOS SACVD二氧化硅主沉积层的上下两处，分别使用SACVD方法在同一反应腔内沉积一层张应力和厚度均小于所述主沉积层的过渡层二氧化硅(buffer layer)，从而得到从压应力到张应力的柔性过渡，使得不同层的应力在多个交界面之间缓慢释放，从而达到在不同应力类型的交界面处的作用力累计成倍减少，最终保证整个二氧化硅薄膜的连续性。因此，本发明所述方法不仅满足了对IMD填充能力的要求，而且有效消除了交界面处的孔洞，而且该方法也不会额外增加制造成本。

说明书

技术领域

本发明涉及半导体晶圆制造工艺，尤其涉及一种半导体晶圆制造中金属间电介质(IMD)的填充方法。

背景技术

在传统的0.25um以上半导体晶圆制造工艺中，一般都是只单纯采用O3TEOS SACVD(Sub-Atmospheric Chemical Vapor Deposition，次大气压化学气相沉积)的方法来实现后段IMD(Inter Metal Dielectric，金属间电介质)的填充。这种方法虽然考虑到了对IMD填充能力的要求，但却忽视了SACVD所沉积出的二氧化硅绝缘薄膜102与其顶层及底层PECVD(等离子体增强化学气相淀积)所沉积出的二氧化硅绝缘薄膜101、103之间的匹配问题，从而导致在SACVD所沉积出二氧化硅电介质102和PECVD所沉积出的二氧化硅电介质101、103之间遗留下了孔洞(voids)104，相关金属间介质(即上述两种二氧化硅绝缘膜)的填充结构如图1所示。这主要是由于SACVD O3TEOS所沉积出的二氧化硅薄膜102和PECVD所沉积出的二氧化硅薄膜101、103之间的应力不匹配所造成的，因为一般SACVD所沉积出的二氧化硅薄膜102的应力为张应力，而PECVD所沉积出的二氧化硅薄膜101、103的应力为压应力。因此，由于这种两种二氧化硅薄膜间应力不匹配，造成其交界面处易被撕裂从而产生孔洞104(这些孔洞104可通过电子显微镜观察到)，进而影响了整个金属间介质填充结构的强度，而且由于这种填充结构上的不完整可能在后续CMP(化学机械研磨)工艺中造成研磨液残留、过腐蚀等一系列严重问题，因此最终很可能会导致半导体器件失去电性或可靠性大打折扣。

而且，通过实验可以发现，即使用张应力较小的O3TEOS SACVD薄膜(沉积4000A厚度后测量)一次沉积完成O3TEOS SAVCD二氧化硅薄膜102，也有很大几率在SACVD102和PECVD二氧化硅薄膜101、103的交界处产生孔洞104，而且此时的IMD填充能力将受到很大限制。因此，对于这种现象可给出如下定性解释，即在进行金属间介质填充时，如果O3TEOS SACVD二氧化硅薄膜102的一次成膜厚度达到4000A或以上，则即使成膜应力较小，但由于连续成膜，所以在整个块体薄膜内部应力将完全累积到薄膜表面释放，这样就在SACVD二氧化硅薄膜102和PECVD二氧化硅薄膜101、103的交界面处形成了很强大的相互作用力，从而致使将较为疏松的SACVD二氧化硅薄膜扯断，形成孔洞104。

发明内容

本发明要解决的技术问题是提供一种半导体晶圆制造中金属间介质填充方法，可在满足对IMD填充能力要求的同时，还可消除SACVD所沉积出的二氧化硅薄膜与PECVD沉积出的二氧化硅薄膜之间所形成的孔洞。

为解决上述技术问题，本发明提供了一种半导体晶圆制造中金属间介质填充方法，包括以下步骤：

(1)通过反应腔体，在底层PECVD二氧化硅薄膜(301)上沉积第一SACVD二氧化硅过渡层(302)；

(2)在所述反应腔体内不破真空的情况下，在所述第一二氧化硅过渡层(302)上，沉积SACVD二氧化硅主沉积层(303)；

(3)同样在所述反应腔体内不破真空情况下，在所述SACVD二氧化硅主沉积层(303)上，再沉积一层第二SACVD二氧化硅过渡层(304)；

(4)在所述第二SACVD二氧化硅过渡层(304)上，使用PECVD方法，淀积顶层PECVD二氧化硅薄膜(305)；

其中，所述第一SACVD二氧化硅过渡层(302)和第二SACVD二氧化硅过渡层(304)的张应力和厚度均小于所述SACVD二氧化硅主沉积层(303)的张应力和厚度，且所述SACVD二氧化硅主沉积层(303)厚度在范围内。

其中，在所述步骤(1)中，所沉积的第一SACVD二氧化硅过渡层(302)的张应力控制在150Mpa～250Mpa范围内，且厚度在范围内。

在所述步骤(2)中，在沉积所述SACVD二氧化硅主沉积层(303)时，应根据金属间沟道的高宽比增大所述反应腔内部的压力，以得到张应力在350Mpa～450Mpa的范围内、厚度在范围内的SACVD二氧化硅主沉积层(303)。

在所述步骤(3)中，在沉积所述第二SACVD二氧化硅过渡层(304)时，应根据金属间沟道的高宽比，降低所述反应腔内部的压力，以得到张应力在200Mpa～250Mpa的范围内、厚度在范围内的第二SACVD二氧化硅过渡层(304)。

本发明由于采用了上述技术方案，具有这样的有益效果，即通过在O3TEOS SACVD二氧化硅主沉积层的上下两处，分别使用SACVD方法在同一反应腔内沉积一层张应力和厚度均小于所述主沉积层的过渡层二氧化硅(buffer layer)，从而得到从压应力到张应力的柔性过渡，使得不同层的应力在多个交界面之间缓慢释放，从而达到在不同应力类型的交界面处的作用力累计成倍减少，最终保证整个二氧化硅薄膜的连续性。因此，本发明所述方法不仅满足了对IMD填充能力的要求，而且有效消除了交界面处的孔洞，从而增加了金属间介质填充结构的强度，提高了半导体器件的可靠性；另外，该方法易于实现，不会额外增加制造成本。

附图说明

下面结合附图与具体实施方式对本发明作进一步详细的说明：

图1为现有的0.25微米及以上晶圆制造技术中金属间介质填充结构的局部示意图；

图2为本发明所述方法的流程示意图；

图3a-3e为本发明所述方法的一个实施例的中间过程局部结构示意图。

具体实施方式

为避免产生孔洞，本发明所述方法通过在原SACVD O3TEOS的上下两处分别用不同压力和气体流量的SACVD在同一反应腔内(如AppliedMaterials公司的Centura Giga fill CxZ chamber)，在O3TEOS SACVD二氧化硅主沉积层的上下两处，分别沉积一层厚度较薄且张应力在150Mpa～250Mpa之间的过渡二氧化硅，并相应地将SACVD二氧化硅主沉积层的厚度从传统一次沉积的减少至之间，其张应力范围与传统成膜方法一致取350Mpa～450Mpa。从而得到从底部压应力薄膜(PECVD二氧化硅)到中间填充层张应力薄膜(即SACVD二氧化硅主沉积层)再到顶部压应力薄膜(PECVD二氧化硅)的柔性过渡，从而既能最大限度地满足IMD填充的要求(目前最大可以做到的金属间沟道的高宽比为高：宽＝2：1)，又在两个二氧化硅界面处有效消除了孔洞104。

下面通过一个具体的实施例来对本发明所述金属间介质填充方法进行进一步详细描述，具体参考图2和图3a-3e所示：

首先，用SACVD O3TEOS方法，在底层PECVD二氧化硅薄膜301(一般情况下，该层薄膜301的压应力为-160Mpa左右，厚度范围一般为)上沉积一层张应力在150Mpa～250Mpa范围内，且厚度在范围内，优选厚度为的第一SACVD二氧化硅过渡层302，以实现从所述底层PECVD二氧化硅薄膜301到该第一SACVD二氧化硅过渡层302的应力过渡。该第一SACVD二氧化硅过渡层302的厚度可根据填孔要求在上述范围内(即的范围内)进行调节。为了得到良好的填充能力，在一优选实施例中，可使用应用材料公司(Applied Materials)的Centura Giga fill CxZ反应腔(chamber)中来进行该第一SACVD二氧化硅过渡层302的沉积，这时芯片的局部结构如图3b所示。

然后，在反应腔体内不破真空的情况下，通过迅速增加所述反应腔内部的压力，并同时调节反应气体流量(具体调节量根据不同腔体结构的不同而不同，这对于本领域的一般技术人员来说应该是熟悉的)，以得到张应力在350Mpa～450Mpa的范围内，厚度在范围(可依填充条件调节)的二氧化硅介质薄膜，这层薄膜沉积在所述第一SACVD二氧化硅过渡层302之上，并作为实现金属间沟槽填充(IMD)的主沉积层303。在沉积过程中，所述反应腔内部压力的具体取值应根据金属间沟道的高宽比而定，如对于金属间沟道的高宽比为高：宽＝2：1的情况，应将反应腔的压力增加至500torr，这对于本领域的一般技术人员来说，根据金属间沟道的高宽比以及成膜的厚度、张应力等要求是可以作出适当的选择的。优选地所述SACVD二氧化硅主沉积层303的沉积厚度为为了实现大高宽比(aspect ratio)条件下的IMD填充，该层的张应力会较前层和之后沉积的顶层大很多，而且本层是实现IMD填充的主结构。这时形成如图3c所示的结构。

第三步，同样在反应腔体内不破真空情况下，通过降低所述反应腔内部的压力，在所述SACVD二氧化硅主沉积层303上沉积一层张应力在200Mpa～250Mpa的范围内，厚度在范围(视实际条件可调)内的第二SACVD二氧化硅过渡层304。沉积过程中，所述反应腔内部压力的具体取值应根据金属间沟道的高宽比而定，如对于金属间沟道的高宽比为高：宽＝2：1的情况，应将所述反应腔内的压力降低至100torr以下，这对于本领域的一般技术人员来说，根据金属间沟道的高宽比以及成膜的厚度、张应力等要求是可以作出适当的选择的。该第二SACVD二氧化硅过渡层304主要用于实现与顶层PECVD二氧化硅薄膜305的应力过渡。这时的结构图如图3d所示。

第四步，在所述第二SACVD二氧化硅过渡层304上，使用PECVD方法，淀积顶层PECVD二氧化硅薄膜305，一般情况下，淀积后的该顶层PECVD二氧化硅薄膜305的压应力应为-160Mpa左右，厚度应在为范围内。优选地，可选择利用诺发系统公司(Novellus)的Sequel C2反应腔来完成上述淀积过程。这时的结构图如图3e所示。