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基于FPGA的RS(255,223)译码器的设计

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在Blahut提出ReedSolomon码时域译码算法的基础上,提出了一种时域RS(255,223)译码算法,并用FPGA和VerilogHDL语言实现了该译码器。主要包括伴随式计算、改进的BM算法、错误位置计算和错误值计算的硬件电路。

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来源
《科技与创新》 |2007年第1z期|240-241|共2页
作者
李健; 许春凤; 武文红;
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作者单位

内蒙古工业大学信息工程学院;

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原文格式 PDF
正文语种 chi
中图分类信道编码理论;
关键词
RS码; 时域译码; FPGA; CCSDS;

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