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RS(255,223)编译码器的设计与FPGA实现

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介绍了RS(255,223)编译码器的设计,并根据编译码器的不同特点,采用不同结构的GF(28)乘法器.编码器利用多项式除法,采用并行结构;译码器采用Euclid算法,关键模块采用了串并结合的结构.同时给出了算法的FPGA实现,按照自上而下的设计流程,在保证速度的同时最大限度地减少了资源占用.

著录项

来源
《电视技术》 |2006年第11期|17-19,31|共4页
作者
向征; 刘兴钊;
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作者单位

上海交通大学,电子工程系,上海,200240;

上海交通大学,电子工程系,上海,200240;

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原文格式 PDF
正文语种 chi
中图分类电视;
关键词
RS码; Eculid算法; FPGA芯片; 有限域乘法/求逆器; 高清晰度电视;

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