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IC工艺中降低热中子软错误率的方法

摘要

IC工艺中降低热中子软错误率的方案,通过对位于金属层顶部以上、并且与集成电路的金属层直接接触的保护层进行掺杂来提供集成电路、以及用于降低集成电路的热中子软错误率(SER)的方法,其中,该保护层掺杂有额外的热中子吸收材料。该热中子吸收材料可以选自包含Gd、Sm、Cd、B以及其组合的组。该保护层可以包括多个子层,这些子层中的多个子层包括额外的热中子吸收材料。

著录项

  • 公开/公告号CN102610610B

    专利类型发明专利

  • 公开/公告日2015-11-25

    原文格式PDF

  • 申请/专利权人 台湾积体电路制造股份有限公司;

    申请/专利号CN201110210811.0

  • 发明设计人 李永辉;蔡超杰;吴佳芳;曲维正;

    申请日2011-07-26

  • 分类号

  • 代理机构北京德恒律师事务所;

  • 代理人陆鑫

  • 地址 中国台湾新竹

  • 入库时间 2022-08-23 09:31:16

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2015-11-25

    授权

    授权

  • 2012-09-26

    实质审查的生效 IPC(主分类):H01L27/092 申请日:20110726

    实质审查的生效

  • 2012-07-25

    公开

    公开

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