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An Efficient Fault Tolerance Technique for Through-Silicon-Vias in 3-D ICs

机译：3-D ICS中通过硅通孔的高效容错技术

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作者
Mohamed BENABDELADHIM; Wael DGHAIS; Fakhreddine ZAYER; Belgacem HAMDI;
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年度 2018
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1. Through-Silicon-Via Capacitance Reduction Technique to Benefit 3-D IC Performance [J] . Electron Device Letters, IEEE . 2010,第6期

机译：硅通孔减小电容技术可提高3-D IC性能
2. Efficient techniques for the analysis of algorithm-based fault tolerance (ABFT) schemes [J] . Nair V.S.S., Abraham J.A. IEEE Transactions on Computers . 1996,第4期

机译：分析基于算法的容错（ABFT）方案的有效技术
3. Improving Upon Current Fault Tolerance Techniques with Emphasis on Low-Latency Fault Tolerance in Cloud Systems [J] . V. Manoranjitham, Bhulakshmi Bonthu, Shivam Khanna, Journal of computational and theoretical nanoscience . 2018,第8期

机译：强调云系统低延迟容错的电流容错技术
4. An efficient multi-phase test technique to perfectly prevent over-detection of acceptable faults for optimal yield improvement via error-tolerance [C] . Tong-Yu Hsieh, Kuen-Jong Lee, Breuer M.A. VLSI Design, Automation and Test, 2009. VLSI-DAT '09 . 2009

机译：一种有效的多相测试技术，可以完美地防止过度检测出可接受的故障，从而通过容错来优化产量
5. Multi-Layer Fault Tolerance Techniques for High Reliability and Performance: Devices, Systems and Data Centers. [D] . Xu, Xin. 2015

机译：具有高可靠性和高性能的多层容错技术：设备，系统和数据中心。
6. The superior fault tolerance of artificial neural network training with a faultoise injection-based genetic algorithm [O] . Feng Su, Peijiang Yuan, Yangzhen Wang, 2016

机译：基于故障/噪声注入的遗传算法的人工神经网络训练的卓越容错能力
7. Generalized standby-sparing techniques for energy-efficient fault tolerance in multiprocessor real-time systems [O] . Yifeng Guo, Dakai Zhu, Hakan Aydin 2013

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