机译:使用180nm技术的CMOS全加法器的性能分析
机译:使用180nm技术的CMOS全加法器的性能分析
机译:采用180NM CMOS技术的10T全添加器的新颖设计
机译:Cadence 180nm CMOS工艺中绝热加法器的节电和延迟分析
机译:180nm CMOS标准单元技术中数字加法器架构的性能
机译:宽比特CMOS纳米加法器拓扑与应用的泄漏减少技术之间的性能折衷。
机译:基于180nm CMOS技术的基于MEMS的振荡器设计
机译:用Tanner工具设计和模拟180nm低功率CmOs加法器单元