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【24h】

A new dielectric degradation phenomenon in nMOS high-k devices under positive bias stress

机译:在正偏压下的NMOS高k器件中新的介电降解现象

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摘要

A new hole trap generation phenomenon during a positive bias stress in nMOS high-k transistors is reported. Fast transient hole trapping at the generated defects is manifested in a negative threshold voltage shift (DeltaVth) observed after the
机译:据报道,新的孔陷阱生成现象在NMOS高k晶体管中的正偏压期间。生成的缺陷处的快速瞬态空穴捕获在后面观察到的负阈值电压移位(Deltav Th )中。

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