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机译:用于逻辑电路加固的CMOS设计风格
Ming Zhang; Shanbhag N.R.;
机译:混合SET-CMOS逻辑电路的新型静态差分设计风格
机译:混合CMOS逻辑样式的平衡进位反向运载电路的单元设计方法(CDM)
机译:基于传输门的混合CMOS逻辑低功耗高速平衡XOR-XNOR电路的单元设计方法
机译:逻辑电路硬化的CMOS设计风格
机译:CMOS组合逻辑电路级硬化技术的比较
机译:基于光纤的单壁碳纳米管晶体管电路对类似CMOS电路的稳定逻辑操作
机译:使用混合CMOS逻辑件的快速加速器电路的设计与优化
机译:辐射强化CmOs集成电路的测试,设计和建模问题
机译:设计电路系统,扩展现有方法以评估电路设计的可行性,执行电路设计的可行性评估,完善电路设计的第一决策规则,形成电路设计的第二决策规则的方法电路设计,用于为多个预先设计的电路块组织设计者的经验数据,提高胶粘逻辑分配效率,并在设计块之间分配胶粘的多个逻辑元素,并分配胶粘逻辑以在集成电路设备设计中执行方案,转换特定于电路块的接口,选择电路收集器,设计一种包含使能设备测试以验证a正确操作的设备,并开发行为测试台,项圈接口和接口系统
机译:集成电路(IC)设计方法和在CMOS逻辑设计中分析辐射诱发的单事件上位的方法
机译:用于混合CMOS /纳米器件电路的混合电阻器/ FET逻辑解复用器架构设计
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