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梁华国;
中国计算机学会;
组合电路;
机译:基于确定性测试集的组合电路和顺序电路的3权重伪随机测试生成
机译:基于时序逻辑的顺序VLSI电路分层测试生成
机译:顺序过渡测试生成与约束组合卡住测试生成的等效性
机译:利用约束组合固定测试生成加速非循环时序电路的过渡测试生成
机译:VLSI数字电路中的串扰故障测试生成和分层时序验证。
机译:基于极限学习机的模拟电路故障检测测试生成算法
机译:具有实际缺陷覆盖范围的组合电路的分层测试生成
机译:基于deBruijn图的模块化分层分解的大约束长度高速维特比解码器
机译:基于可编程逻辑电路的电子电路自动测试生成和故障仿真的装置和方法
机译:可编程逻辑器件集成电路的约束驱动测试生成
机译:分层集成电路布局中总线感知宏块引脚放置的基于约束编程的方法
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