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Variable delay circuit for controlling delay time and DLLDelay Locked Loop thereof

机译:用于控制延迟时间的可变延迟电路及其DLL延迟锁定环

摘要

PURPOSE: A delay time control circuit for controlling a delay time of a variable delay circuit and a DLL(Delay Locked Loop) having the same are provided to control the delay time without an additional work after a package is completed. CONSTITUTION: A delay time control circuit includes a phase detector(110), a control portion(120), a fuse portion(130), and a selector(140). The phase detector compares a reference clock signal to a predetermined output clock signal and generates a predetermined code control signal. The control portion generates the first code signal of m bits in response to the first control signal and the code control signal. The fuse portion receives the first code signal and cuts the internal fuses in response to the second control signal if the first code signal is fixed to a predetermined value. In addition, the fuse portion generates the second code signals of m bits corresponding to logical values of the cut fuses. The selector selects one of the first code signal and the second code signal in response to the first control signal and outputs the selected signal in order to control a delay time of a variable delay circuit(150).
机译:目的:提供用于控制可变延迟电路的延迟时间的延迟时间控制电路和具有该延迟时间控制电路的DLL(延迟锁定环),以在完成封装之后无需额外的工作即可控制延迟时间。构成:延迟时间控制电路包括鉴相器(110),控制部分(120),保险丝部分(130)和选择器(140)。鉴相器将参考时钟信号与预定输出时钟信号进行比较,并产生预定代码控制信号。控制部分响应于第一控制信号和代码控制信号而产生m位的第一代码信号。如果第一代码信号固定为预定值,则保险丝部分接收第一代码信号并响应于第二控制信号切断内部保险丝。另外,保险丝部分产生对应于切断的保险丝的逻辑值的m位的第二代码信号。选择器响应于第一控制信号选择第一代码信号和第二代码信号中的一个,并输出选择的信号,以便控制可变延迟电路的延迟时间(150)。

著录项

  • 公开/公告号KR20030050351A

    专利类型

  • 公开/公告日2003-06-25

    原文格式PDF

  • 申请/专利权人 SAMSUNG ELECTRONICS CO. LTD.;

    申请/专利号KR20010080769

  • 发明设计人 JUNG HOE JU;KIM GYU HYEON;

    申请日2001-12-18

  • 分类号G11C8/00;

  • 国家 KR

  • 入库时间 2022-08-21 23:46:49

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