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Operand-optimized asynchronous floating-point units and method of use thereof

机译:操作数优化的异步浮点单元及其使用方法

摘要

Asynchronous arithmetic units including an asynchronous IEEE 754 compliant floating-point adder and an asynchronous floating point multiplier component. Arithmetic units optimized for lower power consumption and methods for optimization are disclosed.
机译:异步算术单元,包括异步IEEE 754兼容浮点加法器和异步浮点乘法器组件。公开了为降低功耗而优化的算术单元和优化方法。

著录项

  • 公开/公告号US9524270B2

    专利类型

  • 公开/公告日2016-12-20

    原文格式PDF

  • 申请/专利权人 RAJIT MANOHAR;BASIT R. SHEIKH;

    申请/专利号US201213663970

  • 发明设计人 BASIT R. SHEIKH;RAJIT MANOHAR;

    申请日2012-10-30

  • 分类号G06F17/10;G06F7/485;

  • 国家 US

  • 入库时间 2022-08-21 13:43:19

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