一种高性能非精确冗余二进制乘法器的设计方法

摘要

本发明公开了一种高性能非精确冗余二进制乘法器及其设计方法，该非精确冗余二进制乘法器由非精确Booth编码单元、精确Booth编码单元、非精确冗余二进制4‑2压缩器单元、精确冗余二进制4‑2压缩器单元、精确压缩树形结构单元以及冗余二进制数到普通二进制数转换单元组成，其中非精确冗余二进制乘法器乘积的H比特高位是使用精确的Booth编码单元和精确的冗余4‑2压缩器单元得到的,乘积的L比特低位是使用非精确的Booth编码单元和非精确的冗余4‑2压缩器单元得到的。本发明是一种新型的高速、低功耗、小面积的乘法器，在实时嵌入式处理和其他低功耗数字电路设计领域具有很广阔的应用前景。