一种高速低功耗多码率的Viterbi译码器

摘要

本发明公开了一种高速低功耗多码率的Viterbi译码器，包括分支度量单元、加比选单元、路径度量存储单元、幸存路径存储单元、输出单元和控制单元，加比选单元接收分支度量单元的分支度量值并将处理后得到的幸存路径送到幸存路径存储单元进行译码处理得到译码比特，同时将加比选得到的路径度量值存入路径度量存储单元以备下次的加比选处理。本发明适用于(2，1，7)卷积码的Viterbi译码器，具有高吞吐率，低功耗特点，可支持1/2，2/3，3/4，5/6码率。译码器采用全并行的加比选(ACS)单元，最高位清零防溢出处理，采用了一种可降低功耗的寄存器交换法，可有效减少寄存器翻转动态功耗，能根据信噪比的大小自动调整功率。