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一种高速viterbi译码器及译码算法的FPGA实现方法

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摘要

本发明公开了一种高速viterbi译码器及译码算法的FPGA实现方法。所述译码器包括输入转换及分支量度计算电路；相加、比较、选择电路；状态量度存储器；幸存路径存储和回溯译码模块；顶层调用模块。同时，本发明采用VHDL代码实现，可以在接近理论值纠错性能的基础上实现高达100Mbps的译码速率吞吐率。

法律状态公告日

法律状态信息

法律状态
2018-08-03

发明专利申请公布后的驳回 IPC(主分类):H03M13/23 申请公布日:20141203 申请日:20130524

发明专利申请公布后的驳回
2014-12-31

实质审查的生效 IPC(主分类):H03M13/23 申请日:20130524

实质审查的生效
2014-12-03

公开

公开

1. 一种高速viterbi译码器及译码算法的FPGA实现方法 [P] . 中国专利： CN104184481A . 2014-12-03
2. 一种基于FPGA的高速RS编译码器实现方法 [P] . 中国专利： CN102122964A . 2011-07-13
3. HIGH SPEED VITERBI DECODING METHOD WITH ANALOG IMPLEMENTATION AND CIRCULAR CONNECTION OF ITS TRELLIS DIAGRAM [P] . 韩国专利： KR100732183B1 . 2007-06-25

机译：模拟实现及其网格图圆形连接的高速Viterbi解码方法
4. METHOD AND APPARATUS FOR EFFICIENTLY READING AND STORING STATE METRICS IN MEMORY FOR HIGH-SPEED ACS VITERBI DECODER IMPLEMENTA [P] . IL152117A . 2003-05-29

机译：有效读取和存储高速ACS viterbi解码器实现的内存中的状态度量的方法和装置
5. METHOD AND APPARATUS FOR EFFICIENTLY READING AND STORING STATE METRICS IN MEMORY FOR HIGH SPEED ACS VITERBI DECODER IMPLEMENTATIONS. [P] . MXPA02009796A . 2003-05-27

机译：有效读取和存储高速ACS维特比译码器实现中的状态量度的方法和装置。