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机译:软错误弹性和余量增强的N-P反向6T SRAM位单元
Yoshimoto Shusuke; Kawaguchi Hiroshi; Yoshimoto Masahiko;
机译:65nm技术中SRAM 6T位单元的软容错布局的仿真和实验评估
机译:采用65 nm CMOS技术的SEU弹性SRAM位单元
机译:具有分开的字线结构的多位翻转和单位翻转弹性8T SRAM位单元布局
机译:基于隧道晶体管的SUR-10nm域的6T SRAM位电路设计
机译:基于7NM FinFET的6T SRAM细胞瞬态和DC分析性能分析
机译:具有双端SRAM存储器的6T位单元,具有单端读取和单端写功能以及针对多端口存储器的优化位单元
机译:用于单端口静态随机存取存储器(SRAM)的6T位单元,具有单端读取和单端写入
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