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Survey on Power Optimization Techniques for Low PowerVLSI Circuitsin Deep Submicron Technology

机译：低功耗电路电路电力技术电力优化技术调查

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Suguna T; Janaki Rani M;
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年度 2018
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1. Survey on Power Optimization Techniques for Low PowerVLSI Circuitsin Deep Submicron Technology [J] . T. Suguna, M. Janaki Rani International Journal of VLSI Design & Communication Systems . 2018,第1期

机译：深亚微米技术中低功率VLSI电路的功率优化技术概述
2. Power Optimization Techniques for Deep Submicron Devices [J] . S. Senthilrani, M. Suganthi Journal of Nanoelectronics and Optoelectronics . 2013,第4期

机译：深亚微米器件的功率优化技术
3. Power dissipation sources and possible control techniques in ultra deep submicron CMOS technologies [J] . Ndubuisi Ekekwe, Ralph Etienne-Cummings Microelectronics journal . 2006,第9期

机译：超深亚微米CMOS技术中的功耗源和可能的控制技术
4. Low voltage low power CMOS design techniques for deep submicron ICs [C] . Liqiong Wei, Roy, K. . 2000

机译：用于深亚微米IC的低压低功耗CMOS设计技术
5. Leakage power analysis and optimization in deep -submicron technologies under process variation. [D] . Shah, Saumil S. 2007

机译：在工艺变化下深亚微米技术的泄漏功率分析和优化。
6. Deep Submicron EGFET Based on Transistor Association Technique for Chemical Sensing [O] . Salvatore A. Pullano, Nishat T. Tasneem, Ifana Mahbub, 2019

机译：基于晶体管关联技术的深亚微米EGFET用于化学传感
7. Leakage Power Reduction Techniques in Deep Submicron Technologies for VLSI Applications [O] . Priya M.Geetha, Baskaran K., Krishnaveni D. 2012

机译：用于VLSI应用的深亚微米技术中的漏电降低技术
8. Performance and Power Optimization for Cognitive Processor Design Using Deep-Submicron Very Large Scale Integration (VLSI) Technology [R] . Wu, Q., Qiu, Q. 2010

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