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基于FPGA与DDR2 SDRAM的高速ADC采样数据缓冲器设计

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摘要

介绍了一种基于现场可编程门阵列(FPGA)和第二代双倍数据率同步动态随机存取记忆体(DDR2)的高速模数转换(ADC)采样数据缓冲器设计方法,论述了在Xilinx V5 FPGA中如何实现高速同步时钟设计和高速数据同步接收设计.

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来源
《舰船电子对抗》|2010年第1期|104-108|共5页
作者
徐家刚; 张永伟; 徐瑞荣;
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作者单位

船舶重工集团公司723所,扬州,225001;

船舶重工集团公司723所,扬州,225001;

船舶重工集团公司723所,扬州,225001;

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原文格式 PDF
正文语种 chi
中图分类设计与性能分析;设计;
关键词
现场可编程门阵列; 模数转换器; 数据缓冲器;

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