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林美东; 文治平; 张健;
中国航天科技集团公司第七七二研究所;
北京100076;
自偏置; 锁相环; 宽输入范围; CMOS工艺; 高速; SERDES芯片;
机译:用于SerDes接口的具有自适应快速锁定方案的低抖动三阶自偏置PLL
机译:用于6.25 Gbps SerDes的Bang-Bang PLL的设计和分析
机译:倒装芯片球栅阵列封装上高速SerDes接口的新型信道特性估计方法
机译:高速Serdes芯片自偏压PLL技术研究
机译:利用CMOS技术设计重影消除芯片的锁相环(PLL)
机译:使用基于高速阻抗检测技术的片上心脏芯片的药物心脏安全性高通量评估
机译:基于生物逼真混合时态处理单元的高速物体识别芯片。
机译:绿色技术平台,用于MS0-GBQ-AMC-LCO时钟,无PLL SerDes,轮胎安全性,无电感器-PDSL和无孔ESDSL-PCB上的绿色芯片设计
机译:高速,低功耗的DDFS驱动的PLL设计技术DDFS驱动的PLL频率合成器
机译:基于分数N PLL的SerDes时钟恢复
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