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任全会; 赵雨虹;
郑州铁路职业技术学院,河南郑州450052;
FPGA; 时钟数据恢复; 采样;
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机译:基于1-16 GB / S的全数字阶段内插器的时钟和数据恢复电路及深亚微米CMOS晶体管在低温温度下的可靠性研究
机译:基于模型的设计浮点累加器。研究案例:支持向量机内核功能的FPGA实现
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机译:在基于sRam的FpGa TmR设计中实现冗余与奇异时钟域的易感性。
机译:时钟数据恢复电路,包括该时钟数据恢复电路的集成电路以及时钟数据恢复方法
机译:时钟数据恢复电路,包括该时钟数据恢复电路的多端口接收器以及恢复时钟和数据的方法
机译:时钟恢复电路和包括该时钟恢复电路的采样信号生成设备,能够从时钟嵌入数据恢复时钟信号
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