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张国恒; 魏秀芳;
西北民族学院物理系;
兰州师专;
PLA; 状态图; 时序逻辑电路; 触发器; 设计;
机译:利用时钟脉冲发生器合成遗传时序逻辑电路
机译:用于低功耗设计的基于NEM继电器的时序逻辑电路
机译:时序逻辑电路进化设计的三步分解方法
机译:亚阈值状态下绝热复杂时序逻辑电路的设计和分析
机译:基于Scothole Lake,南部中部Alaska南部湖北的Skilak River Outwash Plane ogladation的时序与速率
机译:利用D-Vasim分析遗传逻辑电路的时序分析
机译:组合逻辑电路的最小故障测试时序设计和可测试实现
机译:用于逻辑电路的时序约束生成方法,用于逻辑电路的时序生成约束程序以及用于将逻辑电路的时序生成约束的程序记录介质
机译:逻辑电路的时序约束模型的生成方法,逻辑电路的时序约束模型的生成程序以及使用时序约束模型的时序驱动布局方法
机译:有效地利用多源控制逻辑网络实现时序逻辑电路时序收敛的方法和系统
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