Logic gates; MOSFET; Switches; Multivalued logic; Switching circuits; Threshold voltage;
机译:基于浮栅MOS传输晶体管逻辑的完全并行最近图形匹配的存储逻辑VLSI电路
机译:使用123决策图设计动态传输晶体管逻辑电路
机译:利用123决策图设计动态传输晶体管逻辑电路
机译:使用神经元MOS文字电路和双通道晶体管逻辑的动态三元逻辑门
机译:平衡延迟不敏感的三元逻辑电路,用于缓解侧通道攻击
机译:具有实际门延迟模型的CMOS组合逻辑电路的准确动态功率估算
机译:一种基本逻辑门动态逻辑结构的简单电路