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PRODUCTION OF GAAS ENHANCEMENT AND DEPLETION MODE HEMT'S

机译:GAAS增强和损耗模式HEMT的产生

摘要

A semiconductor device, which comprises an E-mode FET and a D-mode FET and utilizes a two-dimensional electron gas, comprises a semi-insulating semiconductor substrate, a channel layer, an electron-supply layer, a third layer, a first etching-stoppable layer, a fifth layer, and a second etching-stoppable layer, which layers are formed in sequence on the substrate. An etching process for forming grooves of gate electrodes of the FETs comprises a first etching treatment removing the first etching-stoppable layer portion in the E-mode FET region and the second etching-stoppable layer portion in the D-mode FET region, and a second etching treatment removing the third layer portion in the E-mode FET region and the fifth layer portion and using an etchant different from that used in the first etching treatment. In the second etching treatment, reactive ion etching method using a CCl2F2 etchant gas is adopted, since GaAs can be thereby rapidly etched as compared with AlGaAs used for the etching-stoppable layer material.
机译:包括E模式FET和D模式FET并利用二维电子气的半导体器件,包括半绝缘半导体衬底,沟道层,电子供应层,第三层,第一层和第二层。可蚀刻终止层,第五层和第二可终止蚀刻层,这些层依次形成在基板上。用于形成FET的栅极凹槽的蚀刻工艺包括:第一蚀刻处理,去除E模式FET区域中的第一可蚀刻停止层部分和D模式FET区域中的第二可蚀刻停止层部分;以及第二蚀刻处理去除E型FET区域中的第三层部分和第五层部分,并使用与第一蚀刻处理中使用的蚀刻剂不同的蚀刻剂。在第二蚀刻处理中,采用了使用CCl 2 F 2蚀刻剂气体的反应性离子蚀刻方法,因为与用于可蚀刻停止层材料的AlGaAs相比,GaAs能够由此被快速蚀刻。

著录项

  • 公开/公告号DE3566594D1

    专利类型

  • 公开/公告日1989-01-05

    原文格式PDF

  • 申请/专利权人 FUJITSU LIMITED;

    申请/专利号DE19853566594T

  • 发明设计人 SUZUKI MASAHISA;MIMURA TAKASHI;

    申请日1985-04-30

  • 分类号H01L21/82;H01L27/08;H01L29/80;H01L21/306;

  • 国家 DE

  • 入库时间 2022-08-22 06:31:36

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