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Interposer chip, method of manufacturing the interposer chip, and multi-chip package having the interposer chip

机译:中介层芯片,制造中介层芯片的方法以及具有该中介层芯片的多芯片封装

摘要

An interposer chip in accordance includes an insulating layer, conductive patterns and a dummy pattern. The conductive patterns are formed on the insulating layer. The dummy pattern is formed on the insulating layer to suppress a bending of the insulating layer. Further, the dummy pattern can have first isolating grooves formed along peripherals of the conductive patterns to isolate the dummy pattern from the conductive patterns. Thus, the interposer chip is not vulnerable to being bent. Further, an electrical short between the conductive patterns through the dummy pattern caused by particles is substantially avoided.
机译:根据本发明的内插器芯片包括绝缘层,导电图案和虚设图案。导电图案形成在绝缘层上。虚设图案形成在绝缘层上以抑制绝缘层的弯曲。此外,伪图案可以具有沿着导电图案的外围形成的第一隔离槽,以将伪图案与导电图案隔离。因此,内插器芯片不容易弯曲。此外,基本上避免了由粒子引起的通过虚设图案的导电图案之间的电短路。

著录项

  • 公开/公告号US7667331B2

    专利类型

  • 公开/公告日2010-02-23

    原文格式PDF

  • 申请/专利权人 JONG-SEOK LIM;HYO-DONG BAN;

    申请/专利号US20080217643

  • 发明设计人 JONG-SEOK LIM;HYO-DONG BAN;

    申请日2008-07-08

  • 分类号H01L23/48;H01L23/52;H01L29/40;

  • 国家 US

  • 入库时间 2022-08-21 18:48:53

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