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METHOD FOR LAMINATING A DIE, CAPABLE OF REDUCING THE SIZE OF A SEMICONDUCTOR PACKAGE

机译:能够减小半导体封装尺寸的叠层芯片的方法

摘要

PURPOSE: A method for laminating a die is provided to form the multiple structure of a flip chip package by continuously laminating a flip chip die of a single structure.;CONSTITUTION: A first flip chip die (10) with a column (14) is formed. The column is electrically connected to the edge of the first flip chip die. The surface of the column of the first flip chip die is exposed. A second flip chip die (18) is laminated on the first flip chip die. The second flip chip die is electrically connected to the column of the first flip chip die.;COPYRIGHT KIPO 2013
机译:目的:提供一种通过连续地层叠单个结构的倒装芯片管芯来层叠管芯的方法以形成倒装芯片封装的多种结构的方法;组成:具有柱(14)的第一倒装芯片管芯(10)是形成。该列电连接到第一倒装芯片管芯的边缘。第一倒装芯片管芯的列的表面被暴露。第二倒装芯片管芯(18)被层压在第一倒装芯片管芯上。第二个倒装芯片管芯电连接到第一个倒装芯片管芯的列。; COPYRIGHT KIPO 2013

著录项

  • 公开/公告号KR20130113611A

    专利类型

  • 公开/公告日2013-10-16

    原文格式PDF

  • 申请/专利权人 HANA MICRON INC.;

    申请/专利号KR20120035902

  • 发明设计人 JUNG SANG HONG;

    申请日2012-04-06

  • 分类号H01L23/12;H01L23/48;

  • 国家 KR

  • 入库时间 2022-08-21 16:26:06

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