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METHOD AND DEVICE FOR TESTING A CHAIN OF FLIP-FLOPS

机译:用于测试跳动链的方法和装置

摘要

A chain of flip-flops is tested by passing a reference signal through the chain. The reference signal is generated from a test pattern that is cyclically fed back at the cadence of a clock signal. The reference signal propagates through the chain of flip-flops at the cadence of the clock signal to output a test signal. A comparison is carried out at the cadence of the clock signal of the test signal and the reference signal, where the reference signal is delayed by a delay time taking into account the number of flip-flops in the chain and the length of the test pattern. An output signal is produced, at the cadence of the clock signal, as a result of the comparison.
机译:通过将参考信号通过触发器链来测试触发器链。参考信号是由测试图案生成的,该测试图案以时钟信号的节奏循环反馈。参考信号以时钟信号的节奏通过触发器链传播,以输出测试信号。在测试信号的时钟信号和参考信号的节奏上进行比较,其中参考信号被延迟一个延迟时间,其中要考虑链中触发器的数量和测试模式的长度。作为比较的结果,以时钟信号的节奏产生输出信号。

著录项

  • 公开/公告号US2018321308A1

    专利类型

  • 公开/公告日2018-11-08

    原文格式PDF

  • 申请/专利权人 STMICROELECTRONICS (CROLLES 2) SAS;

    申请/专利号US201816031395

  • 发明设计人 SYLVAIN CLERC;GILLES GASIOT;

    申请日2018-07-10

  • 分类号G01R31/3177;G01R31/317;

  • 国家 US

  • 入库时间 2022-08-21 12:56:57

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