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CASE STUDY OF EXPLICIT AND IMPLICIT PULSED FLIP FLOPS WITH CONDITIONAL PULSE ENHANCEMENT MECHANISM

机译：具有条件脉冲增强机制的显式和隐含脉冲触发器的案例研究

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作者
Thara Sebastian; Aravindhan A.;
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年度 2015
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1. Low-Power Pulse-Triggered Flip-Flop Design With Conditional Pulse-Enhancement Scheme [J] . Hwang Y.-T., Lin J.-F., Sheu M.-H. Very Large Scale Integration (VLSI) Systems, IEEE Transactions on . 2012,第2期

机译：具有条件脉冲增强方案的低功耗脉冲触发触发器设计
2. Design of implicit pulsed-dual edge triggering flip flop for low power and high speed clocking systems [J] . Nagarajan P., Kumar N. Ashok, Ramana P. Venkata International Journal of Wavelets, Multiresolution and Information Processing . 2020,第1期

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3. Design of a New Power Efficient Explicit-Pulsed Dual Edge Triggered Sense-Amplifier Flip-Flop [J] . P.Manikanta, R.Ramana Reddy International Journal of Engineering Trends and Technology . 2015,第3期

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4. Performance Comparison of Explicit Pulsed Flip-Flops in Low Power and High-Speed Applications [C] . Kuruvilla John, Vinod Kumar R. S., Kumar S. S. International Conference on Circuits and Systems in Digital Enterprise Technology . 2018

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5. Dual-Edge Triggered Pulsed Flip-Flop With High Performance And High Soft-Error Tolerance. [D] . Gong, Jianping. 2011

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6. Mechanisms That Enhance Sustainability of p53 Pulses [O] . Jae Kyoung Kim, Trachette L. Jackson -1

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