机译:在数字CMOS VLSI电路中使用双亚阈值电源电压进行静态功率优化
机译:使用自调节电压电平电路的纳米级静态CMOS VLSI乘法器电路的待机泄漏功率降低
机译:使用双阈值电压的低功率双电源电压CMOS电路的无电平转换器设计
机译:同步电源,阈值电压和晶体管尺寸优化,可实现CMOS电路的低功耗运行
机译:使用双电源电压合成低功率CMOS VLSI电路
机译:结合可变电源电压和自适应主体偏置的CMOS电路的分析,优化和建模。
机译:拟议的双边沿触发静态D型触发器中的MOSFET沟道宽度和电源电压的多目标优化采用模糊非支配排序遗传算法II
机译:利用双电源电压合成低功率CMOS VLSI电路