机译:使用自调节电压电平电路的纳米级静态CMOS VLSI乘法器电路的待机泄漏功率降低
机译:22 - NM CMOS技术中静态逻辑门的漏电和短路功率降低的新电路级技术
机译:使用自可调电压电平技术的CMOS VLSI数字电路的设计与实现
机译:在数字CMOS VLSI电路中使用双亚阈值电源电压进行静态功率优化
机译:用于降低CMOS VLSI电路中的泄漏功率的电路技术
机译:一种新颖的动态功率截止技术(DPCT),用于降低深亚微米VLSI CMOS电路中的有源泄漏。
机译:为低压可穿戴传感器应用而优化的超薄印刷有机TFT CMOS逻辑电路的制造
机译:降低CMOS VLSI电路泄漏功率的不同低功耗设计技术的比较研究