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韩雁; 宋杭宾; 姚庆栋;
浙江大学CAD&CG国家重点实验室;
浙江大学信电系;
ASIC设计; 集成电路; 浮点乘法器;
机译:信号处理应用中的浮点乘法器设计
机译:一种高速固定宽度浮点乘法器,使用残留物对数系统算法
机译:使用Verilog的高速IEEE-754四重精度浮点乘法器
机译:低面积高速流水线单精度浮点乘法器的设计
机译:使用Altera的设计环境和FPGA设计和实现浮点乘法器
机译:NULL约定浮点乘法器
机译:实现24位高速浮点Vedic乘法器
机译:高速数字系统中同步流水线乘法器的设计及时钟偏差分析
机译:高速乘法器,以小尺寸实现,可以用作处理器的乘法器引擎,并在具有规则性的单一结构中设计
机译:高速浮点型乘法器电路
机译:高速乘法器的处理电路,用于将定点和浮点的操作数相乘
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