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USB 2.0设备控制器IP核的Verilog HDL设计

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摘要

介绍了一种设计USB 2.0设备控制器IP核的方法.着重分析了UTMI接口、协议层、存储器接口、仲裁器及控制和状态寄存器等几个结构模块及其设计.使用上述方法在Xilinx ISE软件平台上,实现了USB 2.0设备控制器IP核的Verilog HDL语言代码及其验证.

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来源
《南京师范大学学报（工程技术版）》 |2003年第4期|66-70|共5页
作者
周芳; 吴宁;
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作者单位

南京航空航天大学信息科学与技术学院,210016,南京;

南京航空航天大学信息科学与技术学院,210016,南京;

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原文格式 PDF
正文语种 chi
中图分类设计;
关键词
USB; IP核; Verilog HDL;

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