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王永海; 周端; 李波; 常宪栋;
西安电子科技大学,计算机学院,陕西,西安,710071;
山东省济南市边防局,山东,济南,251031;
FPU; 乘法运算电路; Booth算法; VerilogHDL语言; Modelsim;
机译:使用第四纪携带展望加法器的低功率和高速乘法器的设计与实现
机译:高速吠陀乘法器的设计与实现
机译:使用3_2压缩机的高速签名乘法器的设计与实现
机译:一种适用于高速复位和开关运算电路的新型低压有限增益补偿技术
机译:一种基于改进的蒙哥马利乘法算法的高速模块化乘法器体系结构。
机译:使用组合组运算的并行点乘法架构用于高速密码应用
机译:高速16X16 CMOS Vedic乘法器的设计与实现
机译:带有pLs接口的耦合BOH FpU 8和FpU 12联运集装箱的可运输性测试,Tp-94-01,“可运输性测试程序”
机译:乘法模块,乘法逆运算电路,乘法逆运算控制系统,使用乘法逆运算的装置,编码装置和纠错解码器
机译:使用乘法模块的装置,乘法逆运算电路,乘法逆运算控制系统,乘员方式逆运算,加密装置,纠错解码器
机译:多精度数据乘积求和运算电路和蒙哥马利乘法累加残差运算电路
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