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陈昭林; 张晋宁; 沈辉;
南京电子技术研究所;
纠错电路; BCH码; NAND; Flash; 现场可编程逻辑门阵列;
机译:多级单元NAND闪存的BCH纠错的VLSI实现
机译:基于内存的编码器和解码器,用于(15,7)双纠错BCH码
机译:在基于SRAM的FPGA中实现双纠错正交拉丁方码
机译:具备纠错能力的BCH实现,用于地球观测卫星中的NAND闪存
机译:用于高速纠错系统的块码维特比解码器的实现。
机译:使用通用图形处理单元(GPGPU)的现代NAND闪存的灵活混合BCH解码器
机译:基于FPGA的(31,k)二进制BCH码编码器的多纠错控制实现
机译:Bch码的迭代译码与Bch界限以外的译码
机译:基于bch码的多位纠错方法和装置及存储系统
机译:基于bch码和存储系统的多比特纠错方法及装置
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