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机译:低压薄氧化物CMOS技术中带有耐压电源轨ESD钳位电路的混合电压I / O接口的ESD保护设计概述
机译:在130-NM CMOS过程中仅使用1-V / 2.5 V低压设备的3.3V I / O接口的电源导轨ESD钳电路
机译:用于低压信号处理应用的高性能CMOS开关电流电路
机译:具有嵌入式PMOSFET的鲁棒和锁定的免疫LVTSCR器件用于28 nm CMOS过程中的ESD保护
机译:采用130-nm CmOs工艺中的1 V / 2.5 V低压器件设计3.3 V I / O接口的电源轨EsD钳位电路
机译:LDRD最终报告 - 研究沉积磁性薄膜在磁记忆技术上的工艺整合对辐射强化CmOs器件和电路的影响 - LDRD项目(FY99)