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欧阳干; 李少青; 王建军;
中国计算机学会;
动态触发寄存器; 分频器; 占空比; 脉冲时钟; 分频电路; 高速串行传输总线;
机译:昏昏欲睡的CMOS休眠堆栈(SC-SS):一种用于VLSI电路设计的新型高速,面积和功率高效技术
机译:关于“用于高速双模预分频器的新型动态触发器”的评论
机译:一种基于新型4/5分频器的低功耗高速32/33预分频器,具有改进的真正单相时钟逻辑
机译:一种新型槽型频率分频器的设计与评估。
机译:高速调频原子力显微镜的宽带低延迟锁相环电路设计的定量比较
机译:一种基于高速串行通信数据传输网络通信接口模块的电路设计
机译:超高速微电路预分频器。
机译:设计电路系统,扩展现有方法以评估电路设计的可行性,执行电路设计的可行性评估,完善电路设计的第一决策规则,形成电路设计的第二决策规则的方法电路设计,用于为多个预先设计的电路块组织设计者的经验数据,提高胶粘逻辑分配效率,并在设计块之间分配胶粘的多个逻辑元素,并分配胶粘逻辑以在集成电路设备设计中执行方案,转换特定于电路块的接口,选择电路收集器,设计一种包含使能设备测试以验证a正确操作的设备,并开发行为测试台,项圈接口和接口系统
机译:高速分频器和使用高速分频器的锁相环
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