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Memory device having improved data reliability by varying program intervals, and method of operating the same

机译:通过不同的程序间隔具有改进的数据可靠性的存储器设备,以及操作方法

摘要

A memory device includes: a memory cell array; a control logic circuit; and a row decoder. The row decoder is configured to activate string selection lines based on control of the control logic circuit. A program interval is formed between a first program operation and a second program operation. The control logic circuit includes a reprogram controller configured to control the row decoder so that a program interval differs in the memory cells connected to different string selection lines among the memory cells connected to a first wordline.
机译:存储器设备包括:存储器单元阵列;控制逻辑电路;和行解码器。行解码器被配置为基于控制逻辑电路的控制来激活字符串选择线。在第一节目操作和第二节目操作之间形成程序间隔。控制逻辑电路包括重新编程控制器,被配置为控制行解码器,使得节目间隔在连接到连接到第一字线的存储器单元之间的存储器单元中连接到不同的串选择线的存储器单元中。

著录项

  • 公开/公告号US11049577B2

    专利类型

  • 公开/公告日2021-06-29

    原文格式PDF

  • 申请/专利权人 SAMSUNG ELECTRONICS CO. LTD.;

    申请/专利号US201916299684

  • 发明设计人 SEUNG-BUM KIM;MIN-SU KIM;DEOK-WOO LEE;

    申请日2019-03-12

  • 分类号G11C16/34;G11C16/12;G11C16/24;G11C16/08;

  • 国家 US

  • 入库时间 2024-06-14 21:44:14

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