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A semiconductor device having an output buffer circuit capable of outputting data while taking impedance matching with an external data transmission line

机译:具有输出缓冲电路的半导体器件,该输出缓冲电路能够在与外部数据传输线进行阻抗匹配的同时输出数据

摘要

Outline of initiation;down pull-down output transistor 184 pulls the potential D of the output node 183 to ground potential GND to pull the pull-down gate control transistor 185a into conduction and pull the output node 183 and the n-channel pull-184 are turned on.
机译:初始化概述;下拉下拉输出晶体管184将输出节点183的电位D拉至地电位GND,以将下拉栅极控制晶体管185a拉至导通,并拉出输出节点183和n沟道下拉184打开。

著录项

  • 公开/公告号KR960032899A

    专利类型

  • 公开/公告日1996-09-17

    原文格式PDF

  • 申请/专利权人 기다오까 다까시;

    申请/专利号KR19960003852

  • 发明设计人 사토 히로토시;

    申请日1996-02-16

  • 分类号H03K19/00;

  • 国家 KR

  • 入库时间 2022-08-22 03:44:30

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