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TIMER BASED STALL AVOIDANCE MECHANISM FOR HIGH SPEED WIRELESS COMMUNICATION SYSTEM

机译:高速无线通信系统中基于定时器的失速避免机制

摘要

This invention uses timers at the transmitter to track its sending data blocks to improve the timer-based stall avoidance mechanism of the prior art. Moreover, the invention uses a multi-timer mechanism to manage reordering buffers at the receiver. The multi-timer mechanism provides the receiver with one timer per reorder buffer, or uses one timer per missing data block, or uses one timer per missing data block but a gap of consecutive TSN missing data blocks can share one timer. The multi-timer mechanism can effectively track the missing blocks and monitor the reorder delivery process for all reordering buffers.
机译:本发明在发射机处使用定时器来跟踪其发送数据块,以改进现有技术中基于定时器的失速避免机制。此外,本发明使用多定时器机制来管理接收机处的重排序缓冲器。多计时器机制为接收器的每个重排序缓冲区提供一个计时器,或者为每个丢失的数据块使用一个计时器,或者为每个丢失的数据块使用一个计时器,但是连续的TSN丢失数据块的间隙可以共享一个计时器。多定时器机制可以有效地跟踪丢失的块,并监视所有重新排序缓冲区的重新排序交付过程。

著录项

  • 公开/公告号KR100463975B1

    专利类型

  • 公开/公告日2004-12-30

    原文格式PDF

  • 申请/专利权人

    申请/专利号KR20020078709

  • 发明设计人 지앙샘샤우-샹;

    申请日2002-12-11

  • 分类号H04L12/56;

  • 国家 KR

  • 入库时间 2022-08-21 22:06:11

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