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ACTIVITY COVERAGE ASSESSMENT OF CIRCUIT DESIGNS UNDER TEST STIMULI

机译:测试激励下电路设计的活动范围评估

摘要

Aspects of the disclosed technology relate to techniques of activity coverage assessment. Transistor-level circuit simulation is performed for a circuit design under a set of test stimuli, which determines values of one or more electrical properties for each of circuit elements of interest in the circuit design. The one or more electrical properties are selected based on information of the each of circuit elements of interest, which comprises what circuit element type the each of circuit elements of interest belongs to. Based on the values of the one or more electrical properties, activity coverage information comprising information about which circuit elements in the circuit elements of interest are active or inactive under the set of test stimuli is determined.
机译:所公开的技术的方面涉及活动覆盖率评估的技术。在一组测试刺激下针对电路设计执行晶体管级电路仿真,该测试刺激确定电路设计中每个感兴趣的电路元件的一个或多个电特性的值。基于所关注的每个电路元件的信息来选择一个或多个电特性,该信息包括所关注的每个电路元件属于哪种电路元件类型。基于一个或多个电特性的值,确定活动覆盖率信息,该活动覆盖率信息包括关于感兴趣的电路元件中的哪个电路元件在该组测试刺激下是活动的还是不活动的信息。

著录项

  • 公开/公告号WO2018026696A1

    专利类型

  • 公开/公告日2018-02-08

    原文格式PDF

  • 申请/专利权人 MENTOR GRAPHICS CORPORATION;

    申请/专利号WO2017US44634

  • 发明设计人 SUNTER STEPHEN KENNETH;

    申请日2017-07-31

  • 分类号G06F17/50;G01R31/317;G01R31/3183;

  • 国家 WO

  • 入库时间 2022-08-21 12:45:57

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