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Common metal contact regions having different Schottky barrier heights and methods of manufacturing same

机译:具有不同肖特基势垒高度的常见金属接触区域及其制造方法

摘要

Methods for forming a semiconductor device having dual Schottky barrier heights using a single metal and the resulting device are provided. Embodiments include a semiconductor substrate having an n-FET region and a p-FET region each having source/drain regions; a titanium silicon (Ti—Si) intermix phase Ti liner on an upper surface of the n-FET region source/drain regions; and titanium silicide (TiSi) forming an upper surface of the p-FET region source/drain regions.
机译:提供了一种使用单一金属形成具有双重肖特基势垒高度的半导体器件的方法以及所得的器件。实施例包括具有n-FET区域和p-FET区域的半导体衬底,每个n-FET区域和p-FET区域具有源极/漏极区域。在n-FET区源/漏区的上表面上的钛硅(Ti-Si)混合相Ti衬层;形成p-FET区源极/漏极区的上表面的硅化钛(TiSi)。

著录项

  • 公开/公告号US10276683B2

    专利类型

  • 公开/公告日2019-04-30

    原文格式PDF

  • 申请/专利权人 GLOBALFOUNDRIES INC.;

    申请/专利号US201715718958

  • 发明设计人 TEK PO RINUS LEE;JINPING LIU;RUILONG XIE;

    申请日2017-09-28

  • 分类号H01L21/768;H01L29/40;H01L29/47;H01L29/78;H01L21/265;H01L21/266;H01L21/285;H01L27/092;H01L21/8238;

  • 国家 US

  • 入库时间 2022-08-21 12:13:02

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