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D锁存器和应用该D锁存器的50%占空比三分频器

摘要

本发明公开了一种D锁存器和应用该D锁存器的50%占空比三分频器,D锁存器由相位切换控制模块控制时钟触发的极性,并控制由数据输入输出模块输出数据信号,或者控制由数据锁存模块锁存数据信号并输出。本发明提供的D锁存器实现了时钟上升沿和下降沿均可对其触发,并利用本发明提供的D锁存器连接组成三分频器,输出50%占空比的三分频信号。

著录项

  • 公开/公告号CN101917185B

    专利类型发明专利

  • 公开/公告日2012-05-09

    原文格式PDF

  • 申请/专利权人 广州市广晟微电子有限公司;

    申请/专利号CN201010189121.7

  • 发明设计人 闫金星;

    申请日2010-06-02

  • 分类号

  • 代理机构北京集佳知识产权代理有限公司;

  • 代理人逯长明

  • 地址 510630 广东省广州市天河区五山路五山科技广场C620-641房

  • 入库时间 2022-08-23 09:09:27

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2012-05-09

    授权

    授权

  • 2011-02-02

    实质审查的生效 IPC(主分类):H03K 21/00 申请日:20100602

    实质审查的生效

  • 2010-12-15

    公开

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