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一种基于准循环生成矩阵的高速并行编码器

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摘要

本发明公开了一种基于准循环生成矩阵的高速并行编码器，包括：输入顺序转换模块、并行校验计算模块、校验移位输出模块和信息位/校验位选择输出模块。本发明可降低校验比特并行计算的复杂度，同时简化编码器内部的布线互连复杂度。

1. 一种基于准循环生成矩阵的高速并行编码器 [P] . 中国专利： CN113472358A . 2021-10-01
2. 一种基于准循环生成矩阵的码率兼容LDPC编码器 [P] . 中国专利： CN112039535A . 2020-12-04
3. METHOD FOR GENERATING A MULTIPLE-RATE QUASI-CYCLIC LDPC(MULTIPLE-RATE QUASI-CYCLIC LOW DENSITY PARITY CHECK CODE) BASED ON A PARALLEL BUNDLE OF HYPERPLANES AT EUCLIDEAN GEOMETRYAND AN APPARATUS THEREOF [P] . 韩国专利： KR20120020433A . 2012-03-08

机译：基于超几何平面平行丛的多速率准循环LDPC（多速率准循环低密度奇偶校验码）生成方法及其装置
4. ENCODING METHOD AND ENCODER FOR BLOCK INTERLEAVED QUASI-CYCLIC EXPANDING PARALLEL CODING OF LDPC CODE [P] . 世界知识产权组织专利： WO2013026291A1 . 2013-02-28

机译： LDPC码的块交错准循环扩展并行编码的编码方法和编码器
5. ldpc design utilizing quasi-cyclic constructions and drilling for high rate, high parallelism, and low error floor [P] . BR112015019409A2 . 2017-07-18

机译： ldpc设计利用准循环结构和钻孔来实现高速率，高并行度和低误差层