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On-chip Network Based Multiprocessors Design and Its Key Technology Research

机译：基于片上网络的多处理器设计及其关键技术研究

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大规模片上多核微处理器拥有大量中央处理器（CPU）核，并通过多任务并行的方式使它们协作工作。然而，随着片上CPU核数量的增加，传统总线或者点对点的互联结构已无法满足大量CPU核对通讯结构的面积、功耗以及带宽的需求。同时，作为CPU私有缓存的高速缓存（cache）的数量也随着CPU核数量的增加而增加，传统的cache结构很难满足大量CPU核对cache的低功耗需求。针对上述存在的这些关键技术问题，本论文对大规模片上多核微处理器的低功耗cache技术、片上网络互联技术以及可重构片上网络技术等方面进行了研究。本论文的主要工作内容和创新点如下：（1）为微处理器内存子系统建立功耗模型，分析低功耗ca...

机译：大规模片上多核微处理器拥有大量中央处理器（CPU）核，并通过多任务并行的方式使它们协作工作。然而，随着片上CPU核数量的增加，传统总线或者点对点的互联结构已无法满足大量CPU核对通讯结构的面积、功耗以及带宽的需求。同时，作为CPU私有缓存的高速缓存（cache）的数量也随着CPU核数量的增加而增加，传统的cache结构很难满足大量CPU核对cache的低功耗需求。针对上述存在的这些关键技术问题，本论文对大规模片上多核微处理器的低功耗cache技术、片上网络互联技术以及可重构片上网络技术等方面进行了研究。本论文的主要工作内容和创新点如下：（1）为微处理器内存子系统建立功耗模型，分析低功耗ca...

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作者
罗闳訚;
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作者单位

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年度 2014
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原文格式 PDF
正文语种 zh_CN
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