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【2h】

Write Avoidance Cache Coherence Protocol for Non-volatile Memory as Last-Level Cache in Chip-Multiprocessor

机译：在芯片 - 多处理器中写入避免对非易失性存储器中的最后级别缓存的避免高速缓存协调协调协调协议

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Ju Hee CHOI; Jong Wook KWAK; Chu Shik JHON;
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年度 2014
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1. Write Avoidance Cache Coherence Protocol for Non-volatile Memory as Last-Level Cache in Chip-Multiprocessor [J] . Ju Hee CHOI, Jong Wook KWAK, Chu Shik JHON IEICE transactions on information and systems . 2014,第8期

机译：非易失性存储器的写避免高速缓存一致性协议作为芯片多处理器中的最后一级高速缓存
2. A performance study of cache coherence protocols and write caches for parallel-multithreaded shared-memory multiprocessors [J] . Chao-Chin Wu, Cheng Chen Journal of the Chinese Institute of Engineers . 1998,第1期

机译：并行多线程共享内存多处理器的缓存一致性协议和写缓存的性能研究
3. Hardware–Software Coherence Protocol for the Coexistence of Caches and Local Memories [J] . Alvarez L., Vilanova L., Gonzalez M., Computers, IEEE Transactions on . 2015,第1期

机译：高速缓存和本地内存共存的硬件-软件一致性协议
4. A write update cache coherence protocol for MIN-based multiprocessors with accessibility-based split caches [C] . Algudady, M.S., Das, . 1990

机译：具有基于可访问性的拆分缓存的基于MIN的多处理器的写更新缓存一致性协议
5. Assessment of cache coherence protocols in shared-memory multiprocessors. [D] . Grbic, Alexander. 2003

机译：共享内存多处理器中缓存一致性协议的评估。
6. PPCS: A Progressive Popularity-Aware Caching Scheme for Edge-Based Cache Redundancy Avoidance in Information-Centric Networks [O] . Quang Ngoc Nguyen, Jiang Liu, Zhenni Pan, 2019

机译：PPCS：渐进式普及感知缓存方案用于以信息为中心的网络中基于边缘的缓存冗余避免
7. Cache Coherence Protocol Design and Simulation Using IES (Invalid Exclusive read/write Shared) State [O] . Baghdad Science Journal 2017

机译：使用IE（无效的独占读/写共享）状态缓存相干协调协议设计和仿真

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