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机译:单BJT和双BJT BiCMOS逻辑门中的故障表现
机译:适用于采用低压BiCMOS技术的VLSI的1.5 V全摆幅BiCMOS动态逻辑门电路
机译:BiCMOS门的开路故障
机译:可测试性设计技术,用于检测CMOS / BiCMOS逻辑系列中的延迟故障
机译:错误的单个BJT BiCMOS逻辑门的行为
机译:多值逻辑网络中多值逻辑门的设计和故障检测
机译:微流体逻辑门:压力驱动的两输入3D微流体逻辑门(Adv。Sci。2/2020)
机译:通过晶体管重新排序降低动态BiCmOs逻辑门中的功耗
机译:有缺陷的双BJT BiCmOs逻辑门的行为