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陈廷勇;
深圳市朗驰欣创科技有限公司,广东深圳,518055;
SERDES ; 串行数据传输; 外部参者时钟;
机译:90纳米FPGA I / O缓冲器设计,源同步系统的数据速率为1.6 Gb / s,外部存储器接口的时钟速率为300 MHz
机译:FPGA世界中的SERDES接口:入门
机译:SerDes芯片提升了汽车数字接口的质量
机译:90 nm FPGA I / O缓冲器设计,具有1.6 Gbps数据速率,用于源同步系统和外部存储器接口的300 MHz时钟速率
机译:基于FPGA的可重配置架构的专用外部存储器接口。
机译:双散射康普顿相机数字FPGA系统的基于FPGA的接口
机译:利用FpGa增强型网络接口卡提升基于pC的软件路由器的性能
机译:相对论理论中的时钟问题(时钟悖论),无论是pro还是Con,都记录在文献中的注释参考书目
机译:该电子测量使用可编程逻辑电路(或英语中的fpga)和参考时钟在一个时间间隔内进行瞬时
机译:电话交换机中外部参考脉冲信号的切换过程-将外部参考信号传导到提供参考脉冲序列的模块以同步中央脉冲发生器或时钟
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