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用Verilog HDL实现基于FPGA的通用分频器的设计

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摘要

在数字逻辑电路设计中,常常遇到一些对时钏分频的需求.本文实现了一种基于FPGAFPGA的软件化的分频方法,通过对不同的Verilog HDL语言程序语句进行比较分析和仿真综合.

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来源
《科技广场》 |2008年第10期|215-216|共2页
作者
罗浩; 许艳; 仲佳嘉;
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作者单位

江西趣工大学应用科学学院;

江西赣州;

341000;

江西趣工大学应用科学学院;

江西赣州;

341000;

武汉理工大学信息学院;

湖北武汉430070;

江西趣工大学应用科学学院;

江西赣州;

341000;

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原文格式 PDF
正文语种 chi
中图分类程序设计、软件工程;
关键词
数字逻辑电路设计; 分频器; FPGA; Verilog HDL;

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