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王国强; 段新文;
青海师范大学,青海,西宁,810008;
CPLD; 数据采集; VHDL; 状态机;
机译:掌握基于HDL描述的设计方法:实验中的逻辑电路设计研究 - 连接第三次HDL描述和CPLD①的终端
机译:基于CPLD的DDS多波形发生器设计
机译:基于CPLD_DSP的SVPWM波形发生器设计
机译:基于CPLD技术的专用高速数据采集系统设计
机译:用于磁共振成像的多路复用数据采集系统的设计和分析。
机译:高速多路充敏感数据采集系统自动触发的事件时序
机译:基于AVR和CPLD的便携式高速数据采集系统
机译:时间共享数据采集系统的新型多路复用和数据流控制技术。
机译:多路复用器电路,存储有用于设计多路复用器电路的程序的计算机可读记录介质以及用于设计多路复用器电路的设备
机译:多路复用器电路,其中存储有用于设计多路复用器电路的程序的计算机可读记录介质,以及用于设计多路复用器电路的设备
机译:多路复用器电路,多路复用器电路的设计程序和多路复用器电路的设计装置
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