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JPEG2000算术解码器的VLSI实现

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摘要

介绍了JPEG2000编解码流程以及JPEG2000算术编码的原理.针对传统算术解码器过慢的情况,提出了一种动态的流水线算术解码器结构,给出了相应的硬件实现的框图,该结构通过FPGA验证.采用了TSMC 0.25μm工艺,进行了ASIC的实现.

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来源
《电子科技大学学报》|2006年第6期|920-923|共4页
作者
方晗; 黄全平; 周荣政; 洪志良;
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作者单位

复旦大学专用集成电路国家重点实验室,上海,杨浦区,200433;

复旦大学专用集成电路国家重点实验室,上海,杨浦区,200433;

复旦大学专用集成电路国家重点实验室,上海,杨浦区,200433;

复旦大学专用集成电路国家重点实验室,上海,杨浦区,200433;

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原文格式 PDF
正文语种 chi
中图分类大规模集成电路、超大规模集成电路;
关键词
JPEG2000; 算术编码器; 流水线; MQ编码;
入库时间 2022-08-18 07:47:33

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