基于FPGA时域有限差分算法的设计与实现

赵倩

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基于FPGA时域有限差分算法的设计与实现

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以时域有限差分法的二维形式为例,用Verilog HDL语言加以实现.采用32位单精度浮点数进行加减法和乘法运算,以保证计算的精度.通过modelsim软件仿真,以Altera FPGA的硬件实现来确保设计的正确性.实验结果显示,基于FPGA的时域有限差分法硬件实现方法对提高速度效果明显,是提高算法性能的有效途径.

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来源
《上海电力学院学报》|2017年第1期|69-72,96|共5页
作者
赵倩;
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作者单位

上海电力学院电子与信息工程学院,上海200090;

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原文格式 PDF
正文语种 chi
中图分类 TN791;
关键词
时域有限差分法; 可编程逻辑器件; Verilog硬件描述语言; 二维TM波;
入库时间 2023-07-25 20:36:04

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