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李永生;
淮北职业技术学院,机电工程系,安徽,淮北,235000;
异步时序电路; 卡诺图; 逻辑分析;
机译:异步时序逻辑电路中的故障影响
机译:无竞赛状态分配,用于合成大规模异步时序逻辑电路
机译:自动化异步时序逻辑电路的设计
机译:时间符号仿真,用于逻辑电路异步行为的准确时序验证
机译:基于等效验证的异步睡眠会议逻辑电路的正式验证方法
机译:利用时钟脉冲发生器合成遗传时序逻辑电路
机译:遗传逻辑电路时序分析的仿真方法
机译:时序逻辑电路的辐射特性。
机译:用于逻辑电路的时序约束生成方法,用于逻辑电路的时序生成约束程序以及用于将逻辑电路的时序生成约束的程序记录介质
机译:逻辑电路的时序约束模型的生成方法,逻辑电路的时序约束模型的生成程序以及使用时序约束模型的时序驱动布局方法
机译:逻辑电路的时序约束生成系统以及逻辑电路的时序约束生成方法,控制程序和可读记录介质
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